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研途青年说108讲

发布者：时间：2025-10-20 23:01:24 浏览：

主题一：基于人工表面等离激元的漏波天线

主讲：杨煜

（导师：尚文利、长志伟）

主题二：多环路多输出纳瓦级全CMOS电压基准电路

主讲：余采霖

（导师：曾衍瀚）

主题三：轻量高效YOLOv8无人机河面垃圾检测技术

主讲：梁质彬

（导师：严一尔）

主题四：飞行MF-RIS辅助SWIPT系统的3D轨迹和安全通信联合设计：一种MADRL算法

主讲：温龙深

（导师：赵赛）

主题五：基于信号的深度学习工业故障检测算法研究

主讲：经维

（导师：唐冬）

主办机构

浪live

时间安排

2025年10月20日10：30-12：00

地点

文新楼424

为拓宽研究生学术视野，促进研究生学术交流，营造良好的学术氛围，浪live 主办的“研途青年说”第108讲于10月20日10：30-12：00在文新楼4249举行。本次主讲人为23级研究生杨煜、余采霖、梁质彬、温龙深和经维。

杨煜同学汇报的主题是基于人工表面等离激元的漏波天线，人工表面等离激元（SSPP）是表面等离激元概念在低频段的类比延伸拓展，是电磁波与人工电磁媒质相互作用时在媒质界面产生的一种混合表面电磁模式，具有深亚波长、局域场增强以及非线性色散曲线等特性，在传感器、微波电路、电磁吸波材料、消色差微波器件、天线、环形器等设计中具有重要的应用价值。得益于SSPP的深亚波长特性，基于SSPP的新型电磁器件具有结构紧凑、重量轻、成本低等应用优势，在高集成化的无线通讯系统中有广泛的应用前景。

余采霖同学汇报的主题是多环路多输出纳瓦级全CMOS电压基准电路.针对无源物联网节点对电压基准电路 “超低功耗、高集成、高电源抑制比” 的需求，提出多环路多输出纳瓦级全 CMOS 电压基准电路。该电路无需特殊器件，通过 PTAT 电压产生电路、电压转电流电路及多环路有源负载设计，解决 “无特殊器件获基准电压”“超低功耗下实现多输出” 难题。实测显示，电路版图仅 69μm×88μm，VREF1 温度系数均值 39.36ppm/°C，电源抑制比等性能优异，可满足无源物联网节点中 ADC、LDO 等模块的稳定基准电压需求。

梁质彬同学介绍的是轻量高效YOLOv8无人机河面垃圾检测技术，基于轻量高效YOLOv8的无人机河面垃圾检测方法，通过引入轻量化设计、多尺度特征加权融合、高效卷积模块和异构核选择机制，提出Lightweight Efficient Multi-Scale Pyramid (LEMSP)模块，替换YOLOv8中Neck结构，使其能高效运行于嵌入式设备（如无人机）上，实现河面垃圾的实时检测与分类。该方法在进行多尺度特征提取来保持准确率的同时，让YOLOV8模型通过多尺度特征增强、动态加权融合及轻量化设计，不仅显著提升了目标检测精度和鲁棒性，还优化了计算开销，具备优越的实时性和实用性，有效改进了特征金字塔网络。

温龙深同学聚焦低空经济（LAE）在 6G 网络中的安全与能效需求，提出无人机搭载多功能智能超表面（MF-RIS）的 SWIPT 系统。MF-RIS 具双模式：信号放大提升合法通信质量，能量收集结合信号反射增强保密能效（SEE）。

针对系统非凸耦合优化难题，设计全协作多智能体软演员评论员（mSAC）算法，联合优化无人机轨迹、基站发射波束成形与 MF-RIS 反射系数矩阵。仿真显示，mSAC 收敛速度、稳定性及最大奖励均优于 SAC、PPO 等算法，SEE 较传统 RIS-UAV 提升达 4.1%，且 MF-RIS 能动态分配元素平衡通信与能效，抗窃听效果好，为安全绿色低空网络提供支撑。

经维同学介绍的是基于信号的深度学习工业故障检测算法研究，本研究针对传统工业故障诊断依赖大量标注样本、难以识别新型故障的问题，提出了融合全局与局部注意力机制的零样本学习模型——GLA-ZSL。该模型通过全局先验优化模块（GPRM）与局部特征增强模块（LFEM）提取多层次故障特征，并结合元学习与原型网络度量，实现了在未见样本类别上的高效识别。在TEP、CWRU与JNU等典型工业数据集上的实验结果表明，GLA-ZSL在平均准确率与泛化能力方面均优于现有方法，具有良好的鲁棒性与可扩展性。研究为工业智能诊断提供了一种无需大量标注的新型思路，对实现智能制造与设备健康管理具有重要意义。

杨煜

2023级浪live

通信工程专业

导师：尚文利

主要研究方向：漏波天线

主要科研成果：专利一篇

余采霖

2023级浪live

集成电路工程专业

导师：曾衍瀚

主要研究方向：CMOS电压基准源

主要科研成果：

Y. Zeng, C. Yu, J. Yang, Y. Luo, B. Lei and Y. Li, "A 64.7nA, -65dB@1kHz and Dual-Output CMOS Voltage Reference With Multi-Loop Active Load Without Trimming," in IEEE Transactions on Circuits and Systems II: Express Briefs, doi: 10.1109/TCSII.2025.3577401.